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基于FPGA的ZUC算法快速實現(xiàn)研究

基于FPGA的ZUC算法快速實現(xiàn)研究

祖沖之（ZUC）算法是我國自主研發(fā)的商用序列密碼算法，已被應(yīng)用于服務(wù)器實時運算和大數(shù)據(jù)處理等復(fù)雜需求場景，ZUC的高速實現(xiàn)對于其應(yīng)用推廣具有重要的實用意義。基于此，針對ZUC適用環(huán)境的FPGA實現(xiàn)高性能要求，通過優(yōu)化模乘、模加等核心運算，并采用流水化結(jié)構(gòu)設(shè)計，在FPGA硬件平臺上實現(xiàn)了ZUC算法。實驗結(jié)果表明，ZUC算法核的數(shù)據(jù)吞吐量可達10.4 Gb/s，與現(xiàn)有研究成果相比，降低了關(guān)鍵路徑的延遲，提升了算法工作頻率，在吞吐量和硬件資源消耗方面實現(xiàn)了良好的平衡，為ZUC算法的高性能實現(xiàn)提供了新的解決方案。

為什么說特斯拉造芯片，一般企業(yè)學不得？

特斯拉于8月初發(fā)布了Q2財報，雖然Q2的凈虧損額是去年同期的兩倍還多，但令投資者驚喜的是，該公司的季度總營收40.02億美元，較去年同期增長43%，超出分析師預(yù)期。同樣重磅的消息是在財報發(fā)布后的電話會議中，馬斯克宣布特斯拉自己研發(fā)的自動駕駛芯片“Hardware 3”未來將在Model 3、Model S和Model X等車型中使用。

發(fā)表于：8/19/2018

以FPGA為基礎(chǔ)設(shè)計全數(shù)字鎖相環(huán)

隨著數(shù)字時代的到來，越來越多的領(lǐng)域采用集成電路來設(shè)計電路，F(xiàn)PGA/CPLD等EDA設(shè)計更為廣大硬件工程師所接受。其模塊化設(shè)計為設(shè)計人員帶來了很多方便，節(jié)約了系統(tǒng)的開發(fā)時間，使設(shè)計人員只需要調(diào)用這些模塊或者IP核，然后組合起來就可以實現(xiàn)一個簡單的功能。全數(shù)字鎖相環(huán)（DPLL）就是其中一個典型的例子。然而DPLL在應(yīng)用時存在很多缺陷，例如鎖相時間長、捕捉帶窄等。為了避免這些缺點，本文設(shè)計了一種全新的相位跟蹤倍頻系統(tǒng)，有效地改善了DPLL的這些指標，并在項目中得到了良好的應(yīng)用。

發(fā)表于：8/18/2018

從設(shè)置、加載、啟動看Xilinx FPGA配置流程

盡管FPGA的配置模式各不相同，但整個配置過程中FPGA的工作流程是一致的，分為三個部分：設(shè)置、加載、啟動。

發(fā)表于：8/18/2018

PCB廠泰鼎旺季報喜 7月營收11億創(chuàng)新高

PCB廠泰鼎昨(2)日公布7月營收，以11億元創(chuàng)新高，月增23.81%，年增5.8%，主要受惠泰國廠區(qū)完成產(chǎn)能擴充，目前月產(chǎn)能已達每月460萬平方呎，加上接單明朗推升，法人指出，泰鼎在8、9月接單都可望維持在此高檔水位，可望進一步推升第3季營收攀上歷史新高。

發(fā)表于：8/18/2018

簡談FPGA的上電復(fù)位

大家好，博主最近有事忙了幾天，沒有更新，今天正式回來了。那么又到了每日學習的時間了，今天咱們來聊一聊簡談FPGA的上電復(fù)位，歡迎大家一起交流學習。

發(fā)表于：8/18/2018

一文讀懂為什么要選擇 Python做機器學習

隨著機器學習的興起，Python 逐步成為了「最受歡迎」的語言。它簡單易用、邏輯明確并擁有海量的擴展包，因此其不僅成為機器學習與數(shù)據(jù)科學的首選語言，同時在網(wǎng)頁、數(shù)據(jù)爬取可科學研究等方面成為不二選擇。此外，很多入門級的機器學習開發(fā)者都是跟隨大流選擇 Python，但到底為什么要選擇 Python 就是本文的核心內(nèi)容。

發(fā)表于：8/18/2018

什么?Python+FPGA!?

早年，雖然Python是一款比較容易上手的腳本語言，而且有強大的社區(qū)支持，一些非計算機專業(yè)領(lǐng)域的人都選它作為入門語言。遺憾的是，它不能實現(xiàn)一些非常底層的操控，所以在硬件領(lǐng)域并不起眼。

發(fā)表于：8/18/2018

PCB設(shè)計中BGA器件布局布線經(jīng)驗談

SMT(Surface Mount Technology 表面安裝)技術(shù)順應(yīng)了智能電子產(chǎn)品小型化，輕型化的發(fā)展潮流，為實現(xiàn)電子產(chǎn)品的輕、薄、短、小打下了基礎(chǔ)。SMT技術(shù)在90年代也走向成熟的階段。但隨著電子產(chǎn)品向便攜式／小型化、網(wǎng)絡(luò)化方向的迅速發(fā)展，對電子組裝技術(shù)提出了更高的要求，其中BGA(Ball Grid Array 球柵陣列封裝)就是一項已經(jīng)進入實用化階段的高密度組裝技術(shù)。

發(fā)表于：8/18/2018

FPGA時序約束方法匯總，從易到難的都有

從最近一段時間工作和學習的成果中，我總結(jié)了如下幾種進行時序約束的方法。

發(fā)表于：8/18/2018

如何使用一個DSP block實現(xiàn)4個11位浮點型數(shù)據(jù)乘法運算

隨著深度學習的發(fā)展，為了解決更加抽象，更加復(fù)雜的學習問題，深度學習的網(wǎng)絡(luò)規(guī)模在不斷的增加，計算和數(shù)據(jù)的復(fù)雜也隨之劇增。INTEL FPGA具有高性能，可編程，低功耗等特點，為AI應(yīng)用加速提供了一種靈活、確定的低延遲、高通量、節(jié)能的解決方案。Arria10是INTELFPGA第一代集成IEEE754標準單精度硬浮點DSP block，可以為高復(fù)雜度的深度學習算法提供高精度，高能效的乘法運算。

發(fā)表于：8/18/2018